关于同步置零，异步置零，同步置位，异步置位的区别
最近在看触发器部分，对于同步置零，异步置零，同步置位，异步置位搞得好混，大致知道同步和时钟信号有关，异步是直接发生置零，但是具体怎么区分呢，具体怎么从给出的接线图或者逻辑功能上判断出来呢？回的的好，我还会有加分的，希望大家多多指点小弟我呀。。。
区分：
同步置零是指触发器在时钟信号的激励下，在时钟的上升沿或者下降沿时，触发器内的数据被置零。
异步置零是指触发器在激励信号的激励下，在信号的上升沿或者下降沿时，触发器内的数据被置零。
同步置位是指触发器在时钟信号的激励下，在时钟的上升沿或者下降沿时，触发器内的数据被置位。
异步置位是指触发器在激励信号的激励下，在信号的上升沿或者下降沿时，触发器内的数据被置位。
另外说明一下：
1.所谓的同步，就是指触发器在受到激励信号激励时，输出还要与时钟信号保持一致，即在时钟信号上升沿或下降沿的作用下置零或置位。
2.所谓的异步，就是指触发器输出不必与时钟信号一致，只要有激励信号的上升沿或者下降沿的激励，那么它就会置零或者置位。
扩展资料
常用的触发器-D触发器简介：
D触发器是一个具有记忆功能的，具有两个稳定状态的信息存储器件，是构成多种时序电路的最基本逻辑单元，也是数字逻辑电路中一种重要的单元电路。
在数字系统和计算机中有着广泛的应用。触发器具有两个稳定状态，即"0"和"1"，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态。
触发器有集成触发器和门电路组成的触发器。触发方式有电平触发和边沿触发两种，前者在CP(时钟脉冲)=1时即可触发，后者多在CP的前沿（正跳变0→1）触发。
D触发器的次态取决于触发前D端的状态，即次态=D。因此，它具有置0、置1两种功能。
对于边沿D触发器，由于在CP=1期间电路具有维持阻塞作用，所以在CP=1期间，D端的数据状态变化，不会影响触发器的输出状态。
D触发器应用很广，可用做数字信号的寄存，移位寄存，分频和波形发生器等等。
参考资料来源：百度百科-D触发器
同步置零，异步置零，同步置位，异步置位都是相对于触发器内的数据的变化而言的，它们之间的区别如下：
1、是否受时钟信号CLK约束的区别：
同步置零和同步置位就是在时钟信号上升沿或下降沿时刻出发的信号。而异步置零和异步置位不受CLK（时钟信号）的约束，异步置零和异步置位接收的是激励信号，而不是时钟信号CLK。
2、到达条件时的数据输入端口状态的区别：
同步置零和异步置零到达条件时的数据输入端口状态是全接地的，而同步置位和异步置位到达条件时的数据输入端口状态是有固定数值的。
扩展资料：
D触发器的结构：
D触发器由4个与非门组成，其中G1和G2构成基本RS触发器。电平触发的主从触发器工作时，必须在正跳沿前加入输入信号。如果在CP高电平期间输入端出现干扰信号，那么就有可能使触发器的状态出错。
而边沿触发器允许在CP触发沿来到前一瞬间加入输入信号。这样，输入端受干扰的时间大大缩短，受干扰的可能性就降低了。
边沿D触发器也称为维持-阻塞边沿D触发器。边沿D触发器可由两个D触发器串联而成，但第一个D触发器的CP需要用非门反向。
参考资料来源：百度百科—D触发器
本回答被网友采纳同步置复零，异步置零，同步置位，异步置位都是相对于触发器内的数据的变化而言的，它们之间的区别如下：
1．是否受时钟信号CLK约束的区别：
同步调零和同步整定是时钟信号上升或下降时开始的信号。异步零和异步设置不受CLK（时钟信号）的约束。异步零和异步设置接收激励信号，但不接收时钟信号CLK。
2．条件到达时数据输入端口状态的差异：
同步零和异步零的数据输入端口状态都是接地的，同步零和异步零的数据输入端口状态是固定的。
扩展资料：
D－触发器结构：
D触发器由4个和门组成，其中G1和G2构成基本RS触发器。当主从触发器被电平激活时，必须在前沿前加一个输入信号。如果在CP高电平时输入端有干扰信号，就有可能导致触发器状态失败。
边缘触发器允许在CP触发边缘到达之前的片刻添加输入信号。这样大大缩短了输入干扰的时间，降低了干扰的概率。
EdgeD触发器也称为持续块EdgeD触发器。边D触发器可以由两个D触发器串联而成，但是第一个D触发器的CP需要用一个非门来反转。
本回答被网友采纳同步置零，异步置零，同步置位，异步置位都是相对于触发器内的数据的变化而言的，它们之间的区别如下：
1、是否受时钟信号CLK约束的区别：
同步置零和同步置位就是在时钟信号上升沿或下降沿时刻出发的信号。而异步置零和异步置位不受CLK（时钟信号）的约束，异步置零和异步置位接收的是激励信号，而不是时钟信号CLK。
2、到达条件时的数据输入端口状态的区别：
同步置零和异步置零到达条件时的数据输入端口状态是全接地的，而同步置位和异步置位到达条件时的数据输入端口状态是有固定数值的。
扩展资料：
D触发器的结构：
D触发器由4个与非门组成，其中G1和G2构成基本RS触发器。电平触发的主从触发器工作时，必须在正跳沿前加入输入信号。如果在CP高电平期间输入端出现干扰信号，那么就有可能使触发器的状态出错。
而边沿触发器允许在CP触发沿来到前一瞬间加入输入信号。这样，输入端受干扰的时间大大缩短，受干扰的可能性就降低了。
边沿D触发器也称为维持-阻塞边沿D触发器。边沿D触发器可由两个D触发器串联而成，但第一个D触发器的CP需要用非门反向。
参考资料来源：百度百科—D触发器
寄存器的输出信号，有的受CLK约束，就是当输入信号改变时，输出信号不立刻改变，需要等到CLK的触发，寄存器的输出信号才会随着之前输入的改变而变化。
区别触发器的同步与异步，要弄清楚计数到条件值时，输出信号是否受CLK的限制。再就是记住几个常用的，比如160同步161异步之类的。
至于置零与置位，就是看到达条件时，数据输入端口是全接地还是有固定的数值。追问
数据输入端口全接地是什么呢？有固定的数值又是什么呢？触发器部分的置位置零比较容易混掉呀，能不能讲讲你学这个的经验呢
追答输入端有穿行输入与并行输入，一般以并行输入为置位信号，其中置零是置位的一种，当达到条件时，输出端Q1~4/8的值等于并行输入D1~4/8的值，如果输入端全部接地，相当于输入全部为0，就是置零，输入固定数值就是D1~4/8不全为0，存在高电平位，使得输入值为一个非零的二进制数。
学这个，也没什么经验，看懂数上的例题，再自己做几道习题可以理解的好一些。