目标精度是10位采样率80M以上,还没认真调好。用的是普通的NMOS开关,还没用好的bootstrapped。不知道Cs有没有选对用了3pF,算了下闭环反馈系数大概0.8,据说这个对噪声有影响。
做电容翻转结构SHA所以运放为带自举增益的折叠共源共栅,以下是结构图,辅助运放也是同样结构的folded cascode,供电3.3输入输出共模均为1.65,原来问题也补充了新的图品供参考,谢谢!
单端输入2.15的时域采样结果
分析了你的时域波形,初步结论:
1、时域看基本成功,但明显存在过冲,电路适合的采样频率在100Hz以下。电路改进重点是在提高压摆率的同时减小过冲(特别是上升沿)以提高最高采样率和采样精度。
2、时域特征显然与你频域分析结果不符,对应的功率谱应该是在100Hz附近有一条很高的幅值,然后是幅值依次降低的该频率的各次谐波。这应该是信号分析仪器使用的问题。信号分析时上升沿采样应设置触发电平和负延时时间,信号分析的采样率和采样点数再提高几倍更好,有助于更准确地分析相对阻尼系数、固有频率、压摆率等参数。
非常感谢你!我用的是hspice2010运放的仿真结果:
其实运放最心疼是功耗太大了,不知道你觉得呢?为了时上升下降压摆率差不多把输出支路的电流加了很多,就是7.25-4.68=2.57mA,最好能把电流降下来就好了。这是我网表一部分:
这FFT分析设置有问题吗?开关如下(80M):
我不熟悉这个仿真软件,不明白各项设置的意义。我的分析只是基于信号分析理论和个人实践。
你的这个电路设计,在保证性能条件下,工作电流小一个数量级就好多了。祝你不断取得新的成功。